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該当求人：2578 件

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2578件 （2031〜2040件目を表示中）

    • おすすめ！

    求人番号：71554

    企業名非公開

    経理財務部長

    業種
    証券
    職種
    経理・財務・会計
    年収
    年収非公開
    勤務地
    東京都
    仕事内容：
    以下の業務を課長と共に行う。

    財務諸表の作成
    定期レポートの作成・提出（金融庁・各協会）
    税務申告書の作成・提出
    自己資本規制比率の算出・報告
    経理規程の制定及び改廃
    予算作成・実績との対比・分析
    部門別収益管理
    資金受払いの管理
    資金の借入・運用、利息の受入・支払
    請求書の作成
    銀行届出印の管理
    帳簿、帳票及び証憑類の作成・保管
    リスク総額の算定及び限度枠の管理
    監査・検査対応（会計・税務・金融庁・各協会）
    資金調達に関する業務全般
    決算公告掲載
    給与・賞与計算
    その他、財務経理に関する業務全般　等
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    求人番号：71558

    株式会社インテージテクノスフィア

    プロジェクトリーダー（製薬・医療機器メーカー向けシステム保守・改善）【フレックス・テレワーク積極採用、年収：５２５～８３６万円、勤務地：東京都西東京市】

    業種
    ソフトベンダ 、システム　インテグレータ
    職種
    プロジェクトマネージャー、ヘルプデスク・運用サービス
    年収
    525万円～836万円
    勤務地
    東京都

    英語力不問

    転勤なし

    土日祝休み

    リモートワーク可

    仕事内容：
    １．大手製薬企業・医薬機器企業向けシステムの保守、改善。
    ２．将来はチームマネジメントもお任せします。
    詳細情報 エントリー

    求人番号：71563

    会社名非公開

    システム開発プロジェクトリーダーを急募

    業種
    ICT　その他
    職種
    プロジェクトマネージャー
    年収
    年収非公開
    勤務地
    長野県
    仕事内容：
    旅行業界向けの業務アプリケーションの開発業務におけるPLまたはPM業務。１０人月程度の小規模から、１００人月以上の大規模案件まで各種対応していただく。
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    求人番号：71588

    半導体専業ICファンドリーメーカー

    最大手ファンダリーのPhysical Design Manager & Engineer (ASIC/SoC Place & Route) を募集します。

    業種
    半導体メーカー
    職種
    設計開発
    年収
    700万円～1,200万円
    勤務地
    神奈川県
    仕事内容：
    Responsibilities:
    *Perform the following:
    - Chip/Block level floorplan,
    - Clock tree synthesis,
    - Place & Route,
    - RC extraction,
    - STA, timing closure,
    - IR/EM analysis and fix,
    - DRC/LVS/ERC analysis and fix,
    - Tape-out sign off.
    - Customer on-site support.
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    求人番号：71591

    半導体専業ICファンドリーメーカー

    最大手ファンダリーの APR(AUTO　PR)/フジカル デザインエンジニア/マネジャーを募集します。

    業種
    半導体メーカー
    職種
    設計開発
    年収
    700万円～1,200万円
    勤務地
    神奈川県
    仕事内容：

    -チップ/ブロック　レベル　フロアープラニング
    -クロックツリー　シンシセス
    -プレース＆ルーター
    -RC　エクストラクション
    -STA　タイミング　クロザー
    -IR/EM　アナリシス　及びフィックス
    -DRC/LVS/ERC　アナリシス及びフィックス
    -テープアウト　サインオフ
    -APR　フローデベロプメント

    Responsibilities:
    *Physical design implementation
    *APR flow development
    *Advanced APR solution path finding
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    求人番号：71593

    半導体専業ICファンドリーメーカー

    最大手ファンダリーのDesign Methodology/Flow Development Manager & Engineerを募集します。

    業種
    半導体メーカー
    職種
    設計開発
    年収
    700万円～1,200万円
    勤務地
    神奈川県
    仕事内容：
    Report To: Director or Sr. Manager
    Role:
    *Digital Design Methodology/Flow Development for TSMC advance technologies.
    * Responsible for design/technology performance/power/area (PPA) analysis and optimization for TSMC advance technology nodes.
    * EDA tools Enablement & Certification
    * Customer’s design flow support
    Responsibility:
    * Design/Technology PPA analysis and optimization
    * EDA Tool Enablement & Certification
    *Customer’s design flow support
    詳細情報 エントリー

    求人番号：71594

    半導体専業ICファンドリーメーカー

    最大手ファンダリー/デザインセンター スタンダードセル デザインエンジニア/テック マネジャーを募集します。

    業種
    半導体メーカー
    職種
    設計開発、半導体設計
    年収
    700万円～1,200万円
    勤務地
    神奈川県
    仕事内容：
    -　スタンダードセル回路の定義、　スケマテック、レイアウト及び検証からデザインの作成
    -　業界標準のシミレーションツール（例えばHspice, Spectre）を用いてのディープサブミクロンCMOSテクノロジーのスケマテックデザインの実施。
    -　TSMCテクノロジーのベストPPA （Power、Performance、Area：消費電力、性能、チップ面積）に到達するように回路の最適化を行う。
    -　リーディング・テック・ノードの為の回路パスファインディングとイノベーション
    -　IoTアプリケーションの為のサブ・スレッシュホールド・ボルテージ回路デザイン
    -　レイアウトエンジニアと共同でスピード、パワー及びEMIRのアーチテクチャー最適化を行う.


    - Define standard cell circuit requirement and complete design from schematic, layout and verification.
    - Conduct schematic design of deep-submicron CMOS technologies using industrial standard simulation tool, such as Hspice and/or Spectre.
    - Optimize circuit to achieve best PPA for TSMC technology
    - Path finding and innovation of circuit design for leading edge tech nodes
    - Sub threshold voltage circuit design for IoT application.
    - Co-work with layout engineer to define architecture optimized for speed, power, and EMIR.


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    求人番号：71597

    半導体専業ICファンドリーメーカー

    最大手ファンダリーのMemory Design Engineer and Managerを募集します。

    業種
    半導体メーカー
    職種
    設計開発、半導体設計
    年収
    700万円～1,200万円
    勤務地
    神奈川県
    仕事内容：
    ＊SRAM architecture design
    ＊Read and write critical path design and analysis
    ＊Design of key building blocks (sensing, analog, high voltage, DFT)
    ＊Chip-level design verification
    ＊Embedded non-volatile memory compiler and productization
    ＊Co-work with product/reliability engineer on silicon characterization and reliability qualification
    詳細情報 エントリー

    求人番号：71598

    半導体専業ICファンドリーメーカー

    最大手ファンダリー/デザインセンター スタンダードセル キャラクタライゼーション エンジニア/テック マネジャーを募集します。

    業種
    半導体メーカー
    職種
    設計開発、半導体設計
    年収
    700万円～1,200万円
    勤務地
    神奈川県
    仕事内容：
    - 最先端テクノロジーに対するスタンダードセル　キャラクタライゼーション手法の
    　定義と実現
    -新規セル及び新たなキャラクタライゼーションのパスファインディングとイノベーション

    - IoTアプリケーションに対するサブ・スレッシュホールド・ボルテージ　キャラクタライゼーションの定義
    -最先端の顧客要求に合うような最高クラスのライブラリーキャラクタライゼーション　フローの開発
    -EDAツールベンダーとコミュニケーションをとりプロダクションで発見された問題の解決を行う


    - Define and implement standard cell characterization methodology for leading edge technology.
    - Path finding and innovation of new cell and/or new feature characterization
    - Define sub threshold voltage characterization for IoT application.
    - Develop best-in-class library characterization production flow to meet advanced customers’ requirement.
    - Communication with EDA tool vendor to resolve issues found in production.



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    求人番号：71601

    半導体専業ICファンドリーメーカー

    最大手ファンダリーの レイアウト エンジニア/マネジャーを募集します。

    業種
    半導体メーカー
    職種
    設計開発、半導体設計
    年収
    700万円～1,200万円
    勤務地
    神奈川県
    仕事内容：
    -RDR（リストリクテッド・デザイン・ルール）デザインルールのオプティマイゼーション
    -最先端テクノロジーのスタンダードセル/IOライブラリー、メモリー及びアナログIPの開発
    -　メモリーIP、コンパイラー、テストビークルの開発
    -　スタンダードセル/IOライブラリー、アナログIPの開発
    -　エリアとパフォーマンスのデザインルール　トレードオフの提供
    -　エリアに於けるRDRインパクト低減の為のスタンダードセル/IOライブラリー、メモリー、アナログIPのレイアウトソリューションの発見


    * RDR design rules optimization.
    * Develop Standard Cell/IO Library Memory and Analog IPs in advanced technology.
    * Develop Memory IPs, Compiler and Test Vehicle.
    * Develop Standard Cell/IO Library and Analog. IPs
    * Provide design rules trade-off on area and performance.
    * Find layout solution for Standard Cell/IO Library Memory and Analog IPs to reduce RDR impact on area.

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