募集要項

仕事内容

Responsibilities:
*Perform the following:
- Chip/Block level floorplan,
- Clock tree synthesis,
- Place & Route,
- RC extraction,
- STA, timing closure,
- IR/EM analysis and fix,
- DRC/LVS/ERC analysis and fix,
- Tape-out sign off.
- Customer on-site support.

ポジション

最大手ファンダリーのPhysical Design Manager & Engineer (ASIC

応募条件

■求める学歴
大学卒以上
■求める経験
Requirements:
*Education:
- Bachelor/Master’s degree in Electrical Engineering or Computer Science.
*5-15 years Netlist (or RTL)-GDS physical implementation experience.
*Language: Proficiency in English is basic requirement. Proficiency in Chinese is a plus.
*In depth knowledge of major EDA tools/design flows.
*Experience with TSMC N16 or below technology.
*Experience in block level implementation, chip integration and signoff.
*Experience in Perl/TCL language programming.
*Proven record in multi-million gate design production tapeouts.

*Experience in any of the following is a plus:
- FinFet Design
- TSMC N7 and below technology.
- Low-power implementation methodology.
- Advanced timing signoff methodology.
- Independently complete Netlist-GDS P&R, signoff task.


■マネジメント経験
不要

必要スキル

■求める英語レベル詳細
ビジネスレベル
■他の言語スキル
中国語尚可

求める人物像

*Personal Attributes:
- Aggressive in learning and problem-solving.
- Good communication skill and a good team player.
- Strong project ownership and commitment.
- Self-motivated and can work independently.

雇用形態

正社員

転勤

無

勤務地

神奈川県横浜市

年収

700万円～1,200万円

休日休暇

週休2日（土日）、祝日休、夏休み、年末年始休

担当者メッセージ

ビジネス好調な世界最大手のファンダリーでご活躍頂けます。

管理コード

担当コンサルタント

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  ・新製品開発におけるテストエンジニアのチームを管理し、リードする
  （コンセプトからテスト計画、HW設計、SW開発、認定、サンプリング、検証、生産リリースまで）
  ・最新のATEプラットフォームに関する豊富な知識/テストコスト削減技術に関する実務
  ・テストコスト削減目標を達成するための革新的な改善でチームを導く
  ・チーム内の技術革新とプロセス改善を推進
  ・チーム内の人材育成を推進する
  ・クロスファンクション開発チームとの成果物の整合性の確保
  
  

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  ・SiCおよびIGBTの新製品開発をコンセプトから生産までリードし、予定通りのリリースと技術仕様を満たすことを保証する
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  ・技術マーケティングおよびアプリケーションチームと密接に協力し、製品開発の優先順位を管理し、主要顧客のマイルストーンを確実に達成する。また、生産歩留まりと品質向上、製品ライフサイクル（PCNプロセス）を担当するサステイニングPEチームを率いる
  ・経験豊富な製品エンジニアのチームを管理し、技術指導を行い、ベストプラクティスを導入し、製品開発のあらゆる側面において継続的な改善を推進する
  ・製品予算を管理し、プロジェクトがコストとスケジュールの制約内で納品されるようにする
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  ・SoC、MPU、MCUの設計/アプリケーション/マーケティングチームと連携し、製品の仕様とPMICの要件を理解する
  ・新しいPMIC製品の要件定義
  ・SoC/MPU/MCUの要件に関する最新情報の入手
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  仕事内容：

  
  -チップ/ブロック　レベル　フロアープラニング
  -クロックツリー　シンシセス
  -プレース＆ルーター
  -RC　エクストラクション
  -STA　タイミング　クロザー
  -IR/EM　アナリシス　及びフィックス
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